Elixir M2Y1GH64TU8HD6B-AC Datasheet download pdf (Page 6)

M2Y51H64TU88D0B / M2Y51H64TU88D6B / M2Y1GH64TU8HD0B / M2Y1GH64TU8HD6B

512MB: 64M x 64 / 1GB: 128M x 64

Unbuffered DDR2 SDRAM DIMM Preliminary Edition

REV 0.1 6

08/2008

NANYA TECHNOLOGY CORP. reserves the right to change Products and Specifications without notice.

Functional Block Diagram

(1GB, 2 Rank, 64Mx8 DDR2 SDRAMs)

Serial PD

A0 A2A1

SCL

SDA

SA0 SA2SA1

Serial PDV

DDSPD

DDQ

REF

D0-D15



Notes : 1. DQ-to-I/O wiring may be changed within a byte.

2. DQ/DQS/DM/CKE/CS relationships are maintained as shown.

3. DQ/DQS/ resistors are 22 Ohms +/- 5%

4. BAx, Ax, , , resistors are 5.1 Ohms +/- 5%

5. Address and control resistors are 22 Ohms +/- 5%

DM1

DQS1



DQ8

DQ9

DQ10

DQ15

DQ12

DQ14

DQ13

DQ11

DQS2



DQ16

DQ17

DQ18

DQ23

DQ20

DQ22

DQ21

DQ19

DM2

DQS3



DQ24

DQ25

DQ26

DQ31

DQ28

DQ30

DQ29

DQ27

DM3

DM0

DQS0



DQ0

DQ1

DQ2

DQ7

DQ4

DQ6

DQ5

DQ3

DM5

DQS5



DQ40

DQ41

DQ42

DQ47

DQ44

DQ46

DQ45

DQ43



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

DM6

DQS6



DQ48

DQ49

DQ50

DQ55

DQ52

DQ54

DQ53

DQ51



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

DM7

DQS7



DQ56

DQ57

DQ58

DQ63

DQ60

DQ62

DQ61

DQ59



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQ32

DQ33

DQ34

DQ39

DQ36

DQ38

DQ37

DQ35



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7

DQS4

DM4



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D10

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D11

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D13

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D14

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D15

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



D12

DQS

I/O 0

I/O 1

I/O 6

I/O 5

I/O 4

I/O 3

I/O 2

I/O 7



BA0-BA1

A0-A13





CKE0



A0-A13 : SDRAMs D0-D15

BA0-BA1 : SDRAMs D0-D15

 : SDRAMs D0-D15

CKE : SDRAMs D0-D7

 : SDRAMs D0-D15

 : SDRAMs D0-D15

CKE1

CKE : SDRAMs D8-D15

ODT0

ODT : SDRAMs D0-D7

ODT1

ODT : SDRAMs D8-D15

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